XIO2001ZWS Integrated Circuit Chip PCI Express to PCI Bridge with 125 MHz Maximum Clock Frequency 1 Lane and Surface Mount NFBGA169

Name: XIO2001ZWS Integrated Circuit Chip PCI Express to PCI Bridge with 125 MHz Maximum Clock Frequency 1 Lane and Surface Mount NFBGA169
Brand: ShenZhen Mingjiada Electronics Co.,Ltd.
SKU: XIO2001ZWS
Availability: InStock

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XIO2001ZWS Integrated Circuit Chip PCI Express to PCI Bridge with 125 MHz Maximum Clock Frequency 1 Lane and Surface Mount NFBGA169

大画像 : XIO2001ZWS Integrated Circuit Chip PCI Express to PCI Bridge with 125 MHz Maximum Clock Frequency 1 Lane and Surface Mount NFBGA169

商品の詳細:

起源の場所:	CN
ブランド名:	Original Factory
証明:	Lead free / RoHS Compliant
モデル番号:	XIO2001ZWS

お支払配送条件:

最小注文数量:	10
価格:	Contact for Sample
パッケージの詳細:	NFBGA-169
受渡し時間:	5～8営業日
支払条件:	T/T、L/C、ウェスタンユニオン

連絡先

XIO2001ZWS Integrated Circuit Chip PCI Express to PCI Bridge with 125 MHz Maximum Clock Frequency 1 Lane and Surface Mount NFBGA169

記述

部品番号:	XIO2001ZWS	タイプ:	ブリッジ - PCIe から PCI
最大クロック周波数:	125のMHz	車線の数:	1車線
ポートの数:	1ポート	動作温度:	-40°C〜85°C
ハイライト:	125 MHz Maximum Clock Frequency Integrated Circuit Chip , 1 Lane PCI Express Bridge , Surface Mount NFBGA169

XIO2001ZWS Integrated Circuit Chip PCI Express To PCI Bus Translation Bridge NFBGA169

The XIO2001ZWS is a single-function PCI Express to PCI translation bridge that is fully compliant to the PCI Express to PCI/PCI-X Bridge Specification, Revision 1.0. For downstream traffic, the bridge simultaneously supports up to eight posted and four non-posted transactions. For upstream traffic, up to six posted and four non-posted transactions are simultaneously supported.

Specifications

Applications	PCI Express to PCI Translation Bridge
Interface	PCI Express
Voltage - Supply	1.35V ~ 1.65V, 3V ~ 3.6V
Package / Case	169-LFBGA
Supplier Device Package	169-NFBGA (12x12)
Mounting Type	Surface Mount

Key Features

Full *1 PCI Express™ Throughput
Fully Compliant With PCI Express to PCI/PCI-X Bridge Specification, Revision 1.0
Fully Compliant With PCI Express Base Specification, Revision 2.0
Fully Compliant With PCI Local Bus Specification, Revision 2.3
PCI Express Advanced Error Reporting Capability Including ECRC Support
Support for D1, D2, D3hot, and D3cold
Active-State Link Power Management Saves Power When Packet Activity on the PCI Express Link is Idle, Using Both L0s and L1 States
Wake Event and Beacon Support
Error Forwarding Including PCI Express Data Poisoning and PCI Bus Parity Errors
Uses 100-MHz Differential PCI Express Common Reference Clock or 125-MHz Single-Ended, Reference Clock
Optional Spread Spectrum Reference Clock is Supported
Robust Pipeline Architecture to Minimize Transaction Latency
Full PCI Local Bus 66-MHz/32-Bit Throughput
Support for Six Subordinate PCI Bus Masters with Internal Configurable, 2-Level Prioritization Scheme
Internal PCI Arbiter Supporting Up to 6 External PCI Masters
Advanced PCI Express Message Signaled Interrupt Generation for Serial IRQ Interrupts
Clock Run and Power Override Support
Six Buffered PCI Clock Outputs (25 MHz, 33 MHz, 50 MHz, or 66 MHz)
PCI Bus Interface 3.3-V and 5.0-V (25 MHz or 33 MHz only at 5.0 V) Tolerance Options
Integrated AUX Power Switch Drains VAUX Power Only When Main Power Is Off
Five 3.3-V, Multifunction, General-Purpose I/O Terminals
Memory-Mapped EEPROM Serial-Bus Controller Supporting PCI Express Power Budget/Limit Extensions for Add-In Cards

Applications

Enterprise systems: Data center & enterprise computing
Personal electronics: PC and notebooks
Industrial applications: Factory automation and control, Retail automation & payment, Industrial transport (non-car & non-light truck)

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